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A 28-nm 64-kb 31.6-TFLOPS/W Digital-Domain Floating-Point-Computing-Unit and Double-Bit 6T-SRAM Computing-in-Memory Macro for Floating-Point CNNs
IEEE Journal of Solid-State Circuits ( IF 5.4 ) Pub Date : 2024-03-25 , DOI: 10.1109/jssc.2024.3375359 An Guo 1 , Xi Chen 1 , Fangyuan Dong 1 , Xingyu Pu 1 , Dongqi Li 1 , Jingmin Zhang 1 , Xueshan Dong 1 , Hui Gao 1 , Yiran Zhang 1 , Bo Wang 1 , Jun Yang 1 , Xin Si 1
中文翻译：
用于浮点 CNN 的 28 nm 64 kb 31.6 TFLOPS/W 数字域浮点计算单元和双位 6T-SRAM 内存计算宏
更新日期：2024-03-25
IEEE Journal of Solid-State Circuits ( IF 5.4 ) Pub Date : 2024-03-25 , DOI: 10.1109/jssc.2024.3375359 An Guo 1 , Xi Chen 1 , Fangyuan Dong 1 , Xingyu Pu 1 , Dongqi Li 1 , Jingmin Zhang 1 , Xueshan Dong 1 , Hui Gao 1 , Yiran Zhang 1 , Bo Wang 1 , Jun Yang 1 , Xin Si 1
Affiliation
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用于浮点 CNN 的 28 nm 64 kb 31.6 TFLOPS/W 数字域浮点计算单元和双位 6T-SRAM 内存计算宏
京公网安备 11010802027423号